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	<title>Formations ALSE (France)</title>
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	<description>Leader en France des Formations FPGA &amp; HDL.</description>
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		<title>Formations ALSE (France)</title>
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		<title>Essential Digital Design Techniques</title>
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		<dc:date>2016-09-17T13:11:16Z</dc:date>
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		<description>&lt;p&gt;La formation &#171; Essential Digital Design Techniques &#187; (con&#231;ue par ALSE) a &#233;t&#233; &lt;strong&gt;remise &#224; jour en profondeur &lt;/strong&gt; en Juin 2024 puis en 2025. &lt;br class='manualbr' /&gt;Elle enseigne les principes essentiels des circuits num&#233;riques (programmables &#171; &lt;abbr title=&#034;Field Programmable Gate Array. Composants &#233;lectroniques standard que l'utilisateur &#171; personnalise &#187; en utilisant des langages HDL pour impl&#233;menter des fonctions logiques sp&#233;cifiques de son choix. Un fichier de programmation permet (souvent &#224; la mise sous tension) au composant de se configurer et d'avoir le fonctionnement voulu par le concepteur.&#034;&gt;FPGA&lt;/abbr&gt; &#187; ou &#171; ASIC &#187;) et de leur conception, et elle apporte une culture de base en &#233;lectronique num&#233;rique. &lt;br class='manualbr' /&gt;Cette formation est id&#233;ale pour les ing&#233;nieurs souhaitant s'impliquer dans la conception FPGA sans avoir b&#233;n&#233;fici&#233; d'une formation compl&#232;te en Electronique, comme par exemple les ing&#233;nieurs en logiciel, en conception carte, en RF etc&#8230;&lt;/p&gt;

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&lt;a href="https://www.alse.fr/-Digital-Design-.html" rel="directory"&gt;Digital Design&lt;/a&gt;


		</description>


 <content:encoded>&lt;div class='rss_texte'&gt;&lt;h2 class=&#034;spip&#034;&gt;Pr&#233;sentation&lt;/h2&gt;
&lt;p&gt;EDDT = &lt;em class=&#034;spip&#034;&gt;Essential Digital Design Techniques&lt;/em&gt; (formation con&#231;ue &#224; l'origine par A.L.S.E) enseigne les principes fondamentaux des circuits &#233;lectroniques digitaux (&lt;abbr title=&#034;Field Programmable Gate Array. Composants &#233;lectroniques standard que l'utilisateur &#171; personnalise &#187; en utilisant des langages HDL pour impl&#233;menter des fonctions logiques sp&#233;cifiques de son choix. Un fichier de programmation permet (souvent &#224; la mise sous tension) au composant de se configurer et d'avoir le fonctionnement voulu par le concepteur.&#034;&gt;FPGA&lt;/abbr&gt; &amp; ASIC) et les bases de l'&#233;lectronique.&lt;/p&gt;
&lt;p&gt;Elle permet, ind&#233;pendamment du langage &lt;abbr title=&#034;Hardware Description Language. Langage de Description Mat&#233;rielle : qui permet de mod&#233;liser et de concevoir des circuits logiques en d&#233;crivant leur comportement. Les principaux HDL utilis&#233;s &#224; ce jour sont : VHDL, Verilog, et SystemVerilog.&#034;&gt;HDL&lt;/abbr&gt; utilis&#233;, de comprendre les circuits en logique digitale, et d'acqu&#233;rir les m&#233;thodes de conception qui permettent de concevoir facilement des projets de toute complexit&#233;, avec des r&#233;sultats performants et un comportement fiable.&lt;/p&gt;
&lt;p&gt;On y apprend ainsi comment impl&#233;menter efficacement diff&#233;rents types de structures (arithm&#233;tique, contr&#244;le, traitement de donn&#233;es, machines d'&#233;tats&#8230;) et comment &#233;viter les erreurs de conception qui produisent des r&#233;sultats erratiques et g&#233;n&#232;rent des probl&#232;mes graves de fiabilit&#233;.&lt;/p&gt;
&lt;p&gt;EDDT est un cours qui pr&#233;pare bien aux formations &lt;abbr title=&#034;VHDL = VHSIC Hardware Description Language. Ce Langage de Description Mat&#233;rielle (normalis&#233; IEEE 1076) issu du programme du d&#233;partement am&#233;ricain de la d&#233;fense &#171; VHSIC &#187; (1980), &#233;tait destin&#233; au d&#233;part &#224; d&#233;crire sans ambigu&#239;t&#233; le comportement de ces circuits rapides. Aujourd'hui, il c&#232;de graduellement le pas au SystemVerilog mais il reste encore aujourd'hui utilis&#233; (surtout dans la conception FPGA).&#034;&gt;VHDL&lt;/abbr&gt;, &lt;abbr title=&#034;Le premier Langage de Description Mat&#233;rielle (au m&#234;me titre que le VHDL qui l'a suivi quelques ann&#233;es apr&#232;s). Normalis&#233; IEEE 1364.&#034;&gt;Verilog&lt;/abbr&gt; ou &lt;abbr title=&#034;SystemVerilog (IEEE std 1800) est le premier HDVL (Hardware Description &amp;#38; Verification Language). Il est appel&#233; &#224; remplacer aussi bien le Verilog (qu'il a absorb&#233;) que le VHDL &#224; qui il manque d&#233;sormais trop de choses dans le domaine de la V&#233;rification. C'est donc le Langage des 20 prochaines ann&#233;es et il est incontournable pour les projets complexes (m&#234;me FPGA), pour les ASICs et pour les SOCs. SystemVerilog est le langage sur lequel est fond&#233;e la M&#233;thodologie UVM.&#034;&gt;SystemVerilog&lt;/abbr&gt;, mais qui reste utile aux personnes ayant d&#233;j&#224; une connaissance de ces langages et qui manquent de culture &#171; mat&#233;rielle &#187; et &#233;lectronique.&lt;/p&gt;
&lt;p&gt;L'utilisation d'un &lt;strong&gt;Kit FPGA&lt;/strong&gt; rend les exercices FPGAs attractifs et motivants, tout en familiarisant le participant &#224; l'utilisation des outils de Conception et de V&#233;rification.&lt;/p&gt;
&lt;h2 class=&#034;spip&#034;&gt;&#192; qui est destin&#233;e cette formation ?&lt;/h2&gt;&lt;ul class=&#034;spip&#034; role=&#034;list&#034;&gt;&lt;li&gt; Ing&#233;nieurs ayant une exp&#233;rience dans d'autres domaines (par exemple logiciel) souhaitant acqu&#233;rir des notions en &#233;lectronique et ma&#238;triser rapidement la conception des circuits digitaux.&lt;/li&gt;&lt;li&gt; En pr&#233;paration ou en compl&#233;ment des formations &#171; Langages &#187; de conception.&lt;/li&gt;&lt;li&gt; Aux personnes ayant une connaissance du VHDL ou du Verilog mais manquant des fondamentaux de la conception des Syst&#232;mes Num&#233;riques et de l'&#233;lectronique.&lt;/li&gt;&lt;/ul&gt;&lt;h2 class=&#034;spip&#034;&gt;Contenu de la formation&lt;/h2&gt;&lt;ul class=&#034;spip&#034; role=&#034;list&#034;&gt;&lt;li&gt; Logique combinatoire et s&#233;quentielle.&lt;/li&gt;&lt;li&gt; Asynchrone vs Synchrone.&lt;/li&gt;&lt;li&gt; Les dangers de l'asynchronisme.&lt;/li&gt;&lt;li&gt; Analyse Statique de Timing&lt;/li&gt;&lt;li&gt; Concepts physiques de l'&#233;lectronique et les effets.&lt;/li&gt;&lt;li&gt; Les structures fondamentales (d&#233;codeurs, multiplexeurs, compteurs, arithm&#233;tique, LFSR&#8230;) et leur impl&#233;mentation mat&#233;rielle.&lt;/li&gt;&lt;li&gt; Comment d&#233;velopper et impl&#233;menter des machines &#224; &#233;tats finis (FSM) synchrones et fiables.&lt;/li&gt;&lt;li&gt; Les domaines d'Horloges multiples et principe des travers&#233;es (CDC).&lt;/li&gt;&lt;li&gt; Le flot de conception des composants programmables.&lt;/li&gt;&lt;li&gt; M&#233;thodologies de Conception et V&#233;rification.&lt;/li&gt;&lt;/ul&gt;&lt;h2 class=&#034;spip&#034;&gt;Connaissances requises&lt;/h2&gt;
&lt;p&gt;La participation &#224; cette formation ne demande pas de connaissance pr&#233;alable particuli&#232;re en dehors d'un minimum de culture scientifique (alg&#232;bre de Boole par exemple).&lt;/p&gt;
&lt;h2 class=&#034;spip&#034;&gt;Support de cours&lt;/h2&gt;
&lt;p&gt;Nos manuels de formation sont r&#233;put&#233;s pour &#234;tre les plus d&#233;taill&#233;s et les plus faciles d'utilisation. Leur style, leur contenu et leur exhaustivit&#233; sont uniques dans le monde de la formation. Ils sont souvent utilis&#233;s comme r&#233;f&#233;rence apr&#232;s avoir suivi les cours de formation. Sont compris dans la formation :&lt;/p&gt;
&lt;ul class=&#034;spip&#034; role=&#034;list&#034;&gt;&lt;li&gt; Le Manuel de cours qui constitue une R&#233;f&#233;rence et inclut les explications compl&#232;tes.&lt;/li&gt;&lt;li&gt; Le Cahier des Exercices pratiques pour mettre en &#339;uvre les connaissances.&lt;/li&gt;&lt;li&gt; Les fichiers source, les scripts et les solutions des Exercices.&lt;/li&gt;&lt;/ul&gt;&lt;/div&gt;
		
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